1️⃣ 개요
- DRAM/NAND 공정에서는 약 40개 전후의 단계에서 이온 주입이 사용됨
- 목적에 따라 에너지, 주입량(Dose), 이온 종류, 마스크 패턴을 세밀하게 조정
- 공정 흐름:
Well → Vt Adjust → Source/Drain → LDD
💡 DRAM/NAND의 이온주입은 소자의 전기적 특성과 신뢰성을 정밀 제어하기 위한 핵심 공정
2️⃣ Well Formation (Well 형성)
📘 목적
- 실리콘 기판 위에 MOSFET의 Body 영역 형성
- CMOS 구조에서 pMOS와 nMOS를 분리하기 위한 P-Well / N-Well 형성
⚙️ 방법
| 구분 | 주입 이온 | 설명 |
|---|---|---|
| nMOS | Boron (B) | P-Well 형성 |
| pMOS | Phosphorus (P) | N-Well 형성 |
⚙️ 조건
- High Energy Implanter 사용 (수백 keV~MeV 수준)
📊 구조 예시
| 구조 | 설명 |
|---|---|
| Twin Well | nMOS/pMOS 각각 별도 Well 형성 |
| Triple Well | Deep N-Well 추가 → Substrate Noise 차단 |
Well Implant는 소자 간 전기적 분리를 위한 기초 절연층 역할
3️⃣ Threshold Voltage (Vt) Adjust Implant
📘 목적
- MOSFET의 임계전압(Vt) 을 조절하여
누설전류(Leakage) 및 스위칭 특성 제어
⚙️ 방법
| 소자 | 도핑 종류 | 설명 |
|---|---|---|
| nMOS | p형 Dopant (Boron) | Vt 상승 |
| pMOS | n형 Dopant (Phosphorus) | Vt 하강 |
⚙️ 조건
- Medium Current Implanter 사용
- Gate 형성 전 단계에서 주입 수행
💡 채널 근처의 전하 밀도 조절을 통해 소자의 On/Off 특성을 결정짓는 핵심 공정
4️⃣ Source/Drain (S/D) Implant
📘 목적
- 전류가 흐르는 S/D Junction 형성
- 전류 경로 확보 및 저항 최소화
⚙️ 방법
| 소자 | 주입 이온 |
|---|---|
| nMOS | As, P |
| pMOS | B |
⚙️ 조건 및 특징
- High Current Implanter 사용
- Vt Adjust Implant보다 수백~수천 배 높은 주입량(Dose)
- 도핑 농도 ↑ → 접촉저항(Contact Resistance) 감소
💡 S/D Implant는 전류 흐름과 접촉저항을 결정하는 고농도 도핑 단계
5️⃣ LDD (Lightly Doped Drain)
📘 목적
- Hot Carrier 효과 방지
→ 고에너지 전자가 Gate Oxide 손상 방지
⚙️ 방법
- S/D 근처의 채널 경계에 완만한 도핑 프로파일 형성
- Low Energy / Medium Current Implanter 사용
⚙️ 효과
| 항목 | 설명 |
|---|---|
| 전계 집중 완화 | Hot Carrier 효과 억제 |
| 소자 신뢰성 향상 | 수명 연장 |
| 누설 전류 감소 | Leakage Current 최소화 |
💡 LDD는 고농도 S/D와 채널 사이의 완충층으로 작용하여
전기적 내구성을 향상시키는 핵심 공정
6️⃣ DRAM / NAND 공정 내 응용 구조
| 공정 단계 | 사용 목적 | 특징 |
|---|---|---|
| Well Formation | Body 영역 형성 | 전기적 절연 및 소자 분리 |
| Vt Adjust | 임계전압 조절 | On/Off 특성 제어 |
| S/D Implant | 전류 통로 형성 | 저항 감소, 접촉 성능 향상 |
| LDD | Hot Carrier 억제 | 누설 전류 감소, 신뢰성 향상 |
DRAM/NAND에서는 이 4단계가 모두 포함되며,
각 단계별로 에너지·주입량·이온 종류를 세밀히 조절하여 소자 특성을 정밀 제어한다.
✅ 종합 요약
| 항목 | 설명 |
|---|---|
| 적용 공정 수 | 약 40여 단계에서 이온 주입 활용 |
| 핵심 제어 변수 | Energy, Dose, Ion Species, Mask |
| 공정 흐름 | Well → Vt Adjust → S/D → LDD |
| 핵심 역할 | 전기적 특성, 신뢰성, 누설전류 제어 |
| 장비 구분 | High Energy / Medium / High Current Implanter |
✅ 한줄 요약
DRAM·NAND의 이온 주입 공정은 Well–Vt–S/D–LDD 단계로 구성되며,
각 단계별 이온의 에너지·주입량·종류를 정밀하게 제어해
소자의 전기적 특성과 신뢰성을 결정짓는 핵심 도핑 기술이다.
'반도체 > 반도체 공정' 카테고리의 다른 글
| 이온 주입 공정4 — Ion Implantation Physics (0) | 2025.11.11 |
|---|---|
| 이온 주입 공정3 — Ion Implantation 구성과 Hardware (0) | 2025.11.11 |
| 이온 주입 공정1 — Ion Implantation 공정 개요 (0) | 2025.11.11 |
| PVD6 — PVD 공정 향후 Trends (0) | 2025.11.11 |
| PVD5 — PVD 공정의 Fab 장비의 이해 (0) | 2025.11.11 |